Architektur von Rechensystemen: 12. GI/ITG-Fachtagung, Kiel, by Peter M. Kogge (auth.), Alfons Jammel (eds.) PDF

By Peter M. Kogge (auth.), Alfons Jammel (eds.)

ISBN-10: 3540553401

ISBN-13: 9783540553403

ISBN-10: 3642774229

ISBN-13: 9783642774225

Die Tagungsreihe "Architektur von Rechensystemen" ist das wichtigste deutschsprachige discussion board f}r das Fachgebiet "Rechensysteme". Die Tagungen dienen der Vorstellung neuer Ergebnisse und Entwicklungen aus den Bereichen Betriebssysteme, Rechnerarchitektur, Rechnerorganisation und Verteilte Systeme. Die Tagungen finden in zweij{hrigem Turnus statt und werden abwechselnd vom Fachbereich three "Technische Informatik und Architektur von Rechensystemen" der Gesellschaft f}r Informatik e.V. (GI) und vom Fachbereich four "Technische Informatik" der Informationstechnischen Gesellschaft im VDE (ITG) veranstaltet.

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VI sich in das Gebiet der analytischen Mechanik und Systemdynarnik ein zuarbeiten. Dazu dienen auch die teilweise sehr ausfuhrlichen Bei spiele. Fur die sorgfaltige Erstellung des Manuskriptes mochte ich mich bei Frau Renate Schenk bedanken. Mein Dank gilt auch Frau Sieglinde Hil ler fur ihre beim Anfertigen der Abbildungen bewiesene Geduld.

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C my: es = PUSH y; C m es 3. emf: es = PUSH f ; C m es #i: es =PUSHARGm-i-l; C m es 5. C m

ML [MTH90], Miranda [Tur85] oder Haskell [HW90]. def fdxll,···, x}ml] = e} fn[Xnh· .. 'xnmn ] = en in eo Hierbei bezeichnen Ii die Funktionsnamen und Xi; die formalen Parameter der Funktionsdefinitionen. Die rechten Seiten der Funktionsgleichungen und der Startausdruck konnen weitere, lokale Funktionsdefinitionen obiger Art, BOwie Funktionsanwendungen der Form enthalten. Anonyme, nichtrekursive Funktionen konnen ebenfalls definiert werden und zwar als sub [Xh···, xn] in e und mit Hilfe eines universellen Applikators ap auf Argumente appliziert werden: Die Bedeutung von Funktionsapplikationen ist mit Hilfe von {3- und 6-Reduktionsregeln definiert.

8). e. data and instruction memory are conceptually separated. All memory accesses are performed with full 40-bit words. All addresses are word addresses, therefore no alignment restrictions as in other system are necessary. Since the timing of memory accesses does not fit into the four-stage pipeline, an asynchronous memory interface has been chosen. The execution of the next instructions continues if they do not depend on the result of an outstanding load or are memory accesses themselves. In either of the latter cases the pipeline is stopped and the processor waits for the end of the memory access.

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